Receptor LVDS, SN75LVDS86ADGG, 21, LVTTL, TSSOP, 48-Pines
Documentos Técnicos
Especificaciones
Brand
Texas InstrumentsNúmero de Drivers
21
Tipo de Entrada
LVDS
Tipo de salida
LVTTL
Interfaz
Circuito integrado del receptor
Número de Elementos por Chip
3
Tipo de Montaje
Surface Mount
Tipo de Encapsulado
TSSOP-16
Conteo de Pines
48
Differential Input High Threshold Voltage
100mV
Tensión Umbral de Nivel Bajo de Entrada Diferencial
-100mV
Dimensiones del Cuerpo
12.5 x 6.1 x 1.15mm
Altura
1.15mm
Largo
12.5mm
Tensión de Alimentación Máxima de Funcionamiento
3.6 V
Temperatura Mínima de Funcionamiento
0 °C
Temperatura Máxima de Operación
+70 °C
Anchura
6.1mm
Tensión de Alimentación de Funcionamiento Mínima
3 V
Datos del producto
Serializador/deserializador FlatLink/FPD-Link, Texas Instruments
Transmisores LVDS para su uso con enlaces FPD de 24 bits (display de panel plano) que funcionan a 65 y 85 MHz.
Entradas LVCMOS/LVTTL
Funcionamiento de baja potencia de 3,3 V
Reloj de datos de transmisor PLL
Cumple el estándar TIA/EIA-644 LVDS
LVDS Communication
Low Voltage Differential Signaling, or LVDS, is an electrical signaling system that can run at very high speeds over cheap, twisted-pair copper cables.
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100mV
Tensión Umbral de Nivel Bajo de Entrada Diferencial
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Dimensiones del Cuerpo
12.5 x 6.1 x 1.15mm
Altura
1.15mm
Largo
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Tensión de Alimentación Máxima de Funcionamiento
3.6 V
Temperatura Mínima de Funcionamiento
0 °C
Temperatura Máxima de Operación
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Anchura
6.1mm
Tensión de Alimentación de Funcionamiento Mínima
3 V
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Entradas LVCMOS/LVTTL
Funcionamiento de baja potencia de 3,3 V
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