Búfer, controlador de línea, SN74LV125ADBR, LV, 4 bits 3-State, No Inversión SSOP 14 pines

Documentos Técnicos
Especificaciones
Brand
Texas InstrumentsFamilia Lógica
LV
Función Lógica
Búfer, controlador de línea
Interfaz
Búfer y circuito integrado del controlador de línea
Número de Canales por Chip
4
Tipo de Entrada
Terminación Única
Tipo de salida
3 State
Polarity
Non-Inverting
Tipo de Montaje
Surface Mount
Tipo de Encapsulado
SOP
Conteo de Pines
14
Corriente Máxima de Salida de Alto Nivel
-16mA
Corriente Máxima de Salida de Bajo Nivel
16mA
Maximum Propagation Delay Time @ Maximum CL
16.5 ns @ 2.5 V
Dimensiones del Cuerpo
6.2 x 5.3 x 1.95mm
Tensión de Alimentación Máxima de Funcionamiento
5.5 V
Tensión de Alimentación de Funcionamiento Mínima
2 V
Propagation Delay Test Condition
50pF
Datos del producto
74LV Family, Texas Instruments
Lógica CMOS de tensión baja
Tensión de funcionamiento: 2 a 5,5
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
74LV Family
Price on asking
Each (Supplied on a Reel) (Sin IVA)
Empaque de Producción (Rollo)
10
Price on asking
Each (Supplied on a Reel) (Sin IVA)
Información de stock no disponible temporalmente.
Empaque de Producción (Rollo)
10
Información de stock no disponible temporalmente.
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Especificaciones
Brand
Texas InstrumentsFamilia Lógica
LV
Función Lógica
Búfer, controlador de línea
Interfaz
Búfer y circuito integrado del controlador de línea
Número de Canales por Chip
4
Tipo de Entrada
Terminación Única
Tipo de salida
3 State
Polarity
Non-Inverting
Tipo de Montaje
Surface Mount
Tipo de Encapsulado
SOP
Conteo de Pines
14
Corriente Máxima de Salida de Alto Nivel
-16mA
Corriente Máxima de Salida de Bajo Nivel
16mA
Maximum Propagation Delay Time @ Maximum CL
16.5 ns @ 2.5 V
Dimensiones del Cuerpo
6.2 x 5.3 x 1.95mm
Tensión de Alimentación Máxima de Funcionamiento
5.5 V
Tensión de Alimentación de Funcionamiento Mínima
2 V
Propagation Delay Test Condition
50pF
Datos del producto
74LV Family, Texas Instruments
Lógica CMOS de tensión baja
Tensión de funcionamiento: 2 a 5,5
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS