Inversor, 74HC14D,652, Hex canales SOIC 14 pines HC Sí
Documentos Técnicos
Especificaciones
Brand
NexperiaFunción Lógica
Inverter
Tipo de Entrada
Schmitt Trigger
Número de Elementos por Chip
6
Entrada de disparador Schmitt
Yes
Maximum Propagation Delay Time @ Maximum CL
125 ns @ 2 V, 21 ns @ 6 V, 25 ns @ 4.5 V
Corriente Máxima de Salida de Alto Nivel
-5.2mA
Corriente Máxima de Salida de Bajo Nivel
5.2mA
Tipo de montaje
Montaje superficial
Tipo de Encapsulado
SOIC
Conteo de Pines
14
Familia Lógica
HC
Dimensiones
8.75 x 4 x 1.45mm
Tensión de Alimentación Máxima de Funcionamiento
6 V
Altura
1.45mm
Máxima Temperatura de Funcionamiento
125 °C
Propagation Delay Test Condition
50pF
Largo
8.75mm
Profundidad
4mm
Temperatura Mínima de Operación
–40 °C
Tensión de Alimentación de Funcionamiento Mínima
2 V
Datos del producto
Búferes e inversores de la familia 74HC, Nexperia
Una gama de inversores y búferes NXP de la familia 74HC de los CI de lógica CMOS. La familia 74HC utiliza tecnología CMOS de puerta de silicio para lograr velocidades de funcionamiento similares a las de la familia LSTTL, pero con el bajo consumo de potencia de los circuitos integrados CMOS estándar.
Lógica CMOS de alta velocidad
Tensión de funcionamiento: 2 a 6 V
Compatibilidad: entrada CMOS, salida CMOS
74HC Family
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Inverter
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6
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125 ns @ 2 V, 21 ns @ 6 V, 25 ns @ 4.5 V
Corriente Máxima de Salida de Alto Nivel
-5.2mA
Corriente Máxima de Salida de Bajo Nivel
5.2mA
Tipo de montaje
Montaje superficial
Tipo de Encapsulado
SOIC
Conteo de Pines
14
Familia Lógica
HC
Dimensiones
8.75 x 4 x 1.45mm
Tensión de Alimentación Máxima de Funcionamiento
6 V
Altura
1.45mm
Máxima Temperatura de Funcionamiento
125 °C
Propagation Delay Test Condition
50pF
Largo
8.75mm
Profundidad
4mm
Temperatura Mínima de Operación
–40 °C
Tensión de Alimentación de Funcionamiento Mínima
2 V
Datos del producto
Búferes e inversores de la familia 74HC, Nexperia
Una gama de inversores y búferes NXP de la familia 74HC de los CI de lógica CMOS. La familia 74HC utiliza tecnología CMOS de puerta de silicio para lograr velocidades de funcionamiento similares a las de la familia LSTTL, pero con el bajo consumo de potencia de los circuitos integrados CMOS estándar.
Lógica CMOS de alta velocidad
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