Quad Bus Buffer Gate SN74LVC125APWRG4
Documentos Técnicos
Especificaciones
Brand
Texas InstrumentsFamilia Lógica
LVC
Tipo de montaje
Surface Mount
Tipo de Encapsulado
SOIC
Conteo de Pines
14
Corriente Máxima de Salida de Alto Nivel
-24mA
Corriente Máxima de Salida de Bajo Nivel
24mA
Maximum Propagation Delay Time @ Maximum CL
5.3 ns @ 2.7 V
Dimensiones del Cuerpo
5 x 4.4 x 1.15mm
Tensión de Alimentación Máxima de Funcionamiento
3.6 V
Temperatura de Funcionamiento Máxima
125 °C
Longitud
5mm
Ancho
4.4mm
Tensión de Alimentación de Funcionamiento Mínima
1.65 V
Propagation Delay Test Condition
50pF
Temperatura Mínima de Operación
-40 ºC
Altura
1.15mm
Datos del producto
Búferes e inversores de la familia 74LVC, Texas Instruments
Gama de inversores y búferes de la familia 74LVC de los CI de lógica CMOS de baja tensión de Texas Instruments La familia 74LVC utiliza tecnología CMOS de puerta de silicio y está diseñada para funcionar a 3,3 V, lo que permite una reducción significativa del consumo de energía en comparación con los sistemas de 5 V.
Tensión de funcionamiento: 1,65 a 3,6 V
Entradas tolerantes de 5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento de cierre excede 250 mA conforme a JESD 17
La protección contra ESD excede JESD 22
74LVC Family
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20
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Conteo de Pines
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Corriente Máxima de Salida de Alto Nivel
-24mA
Corriente Máxima de Salida de Bajo Nivel
24mA
Maximum Propagation Delay Time @ Maximum CL
5.3 ns @ 2.7 V
Dimensiones del Cuerpo
5 x 4.4 x 1.15mm
Tensión de Alimentación Máxima de Funcionamiento
3.6 V
Temperatura de Funcionamiento Máxima
125 °C
Longitud
5mm
Ancho
4.4mm
Tensión de Alimentación de Funcionamiento Mínima
1.65 V
Propagation Delay Test Condition
50pF
Temperatura Mínima de Operación
-40 ºC
Altura
1.15mm
Datos del producto
Búferes e inversores de la familia 74LVC, Texas Instruments
Gama de inversores y búferes de la familia 74LVC de los CI de lógica CMOS de baja tensión de Texas Instruments La familia 74LVC utiliza tecnología CMOS de puerta de silicio y está diseñada para funcionar a 3,3 V, lo que permite una reducción significativa del consumo de energía en comparación con los sistemas de 5 V.
Tensión de funcionamiento: 1,65 a 3,6 V
Entradas tolerantes de 5 V
Compatibilidad: entrada LVTTL/TTL, salida LVCMOS
El rendimiento de cierre excede 250 mA conforme a JESD 17
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